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Fundamentals of Logic Design
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페이지 : 정보준비중 | 0.00 * 0.00 * 0.00 (cm)
ISBN-10 : 0534378048
ISBN-13 : 9780534378042
Fundamentals of Logic Design [Hardcover] 중고
저자 Roth, Charles H., Jr. | 출판사 Thomson Learning
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2003년 5월 1일 출간
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Updated for this fifth edition, this text achieves a balance between theory and application. It presents the theory that is necessary for understanding the fundamental concepts of logic design while not overwhelming students with the mathematics of switching theory.

저자소개

목차


Preface xix
How to Use This Book for Self-Study xxiii
Introduction Number Systems and Conversion 1(25)
Objectives 1(1)
Study Guide 2(4)
Digital Systems and Switching Circuits 6(2)
Number Systems and Conversion 8(4)
Binary Arithmetic 12(3)
Representation of Negative Numbers 15(5)
Addition of 2's Complement Numbers 17(1)
Addition of 1's Complement Numbers 18(2)
Binary Codes 20(6)
Problems 23(3)
Boolean Algebra 26(27)
Objectives 26(1)
Study Guide 27(6)
Introduction 33(1)
Basic Operations 34(2)
Boolean Expressions and Truth Tables 36(2)
Basic Theorems 38(1)
Commutative, Associative, and Distributive Laws 39(2)
Simplification Theorems 41(2)
Multiplying Out and Factoring 43(2)
DeMorgan's Laws 45(8)
Problems 47(5)
Laws and Theorems of Boolean Algebra 52(1)
Boolean Algebra (Continued) 53(24)
Objectives 53(1)
Study Guide 54(4)
Multiplying Out and Factoring Expressions 58(2)
Exclusive-OR and Equivalence Operations 60(2)
The Consensus Theorem 62(2)
Algebraic Simplification of Switching Expressions 64(2)
Proving the Validity of an Equation 66(11)
Programmed Exercises 68(6)
Problems 74(3)
Applications of Boolean Algebra Minterm and Maxterm Expansions 77(32)
Objectives 77(1)
Study Guide 78(6)
Conversion of English Sentences to Boolean Equations 84(2)
Combinational Logic Design Using a Truth Table 86(1)
Minterm and Maxterm Expansions 87(3)
General Minterm and Maxterm Expansions 90(3)
Incompletely Specified Functions 93(1)
Examples of Truth Table Construction 94(4)
Design of Binary Adders and Subtracters 98(11)
Problems 101(8)
Karnaugh Maps 109(40)
Objectives 109(1)
Study Guide 110(10)
Minimum Forms of Switching Functions 120(1)
Two- and Three-Variable Karnaugh Maps 121(5)
Four-Variable Karnaugh Maps 126(3)
Determination of Minimum Expressions Using Essential Prime Implicants 129(5)
Five-Variable Karnaugh Maps 134(2)
Other Uses of Karnaugh Maps 136(2)
Other Forms of Karnaugh Maps 138(11)
Programmed Exercises 139(5)
Problems 144(5)
Quine-McCluskey Method 149(24)
Objectives 149(1)
Study Guide 150(5)
Determination of Prime Implicants 155(3)
The Prime Implicant Chart 158(3)
Petrick's Method 161(1)
Simplification of Incompletely Specified Functions 162(1)
Simplification Using Map-Entered Variables 163(2)
Conclusion 165(8)
Programmed Exercise 166(4)
Problems 170(3)
Multi-Level Gate Circuits NAND and NOR Gates 173(28)
Objectives 173(1)
Study Guide 174(5)
Multi-Level Gate Circuits 179(4)
NAND and NOR Gates 183(2)
Design of Two-Level Circuits Using NAND and NOR Gates 185(3)
Design of Multi-Level NAND and NOR Gate Circuits 188(1)
Circuit Conversion Using Alternative Gate Symbols 189(3)
Design of Two-Level, Multiple-Output Circuits 192(4)
Determination of Essential Prime Implicants for Multiple-Output Realization 194(2)
Multiple-Output NAND and NOR Circuits 196(5)
Problems 196(5)
Combinational Circuit Design and Simulation Using Gates 201(23)
Objectives 201(1)
Study Guide 202(3)
Review of Combinational Circuit Design 205(1)
Design of Circuits with Limited Gate Fan-In 206(2)
Gate Delays and Timing Diagrams 208(2)
Hazards in Combinational Logic 210(3)
Simulation and Testing of Logic Circuits 213(11)
Problems 216(2)
Design Problems 218(6)
Multiplexers, Decoders, and Programmable Logic Devices 224(33)
Objectives 224(1)
Study Guide 225(5)
Introduction 230(1)
Multiplexers 230(3)
Three-State Buffers 233(2)
Decoders and Encoders 235(3)
Read-Only Memories 238(4)
Programmable Logic Devices 242(5)
Programmable Logic Arrays 242(3)
Programmable Array Logic 245(2)
Complex Programmable Logic Devices 247(2)
Field Programmable Gate Arrays 249(8)
Decomposition of Switching Functions 250(3)
Problems 253(4)
Introduction to VHDL 257(33)
Objectives 257(1)
Study Guide 258(4)
VHDL Description of Combinational Circuits 262(3)
VHDL Models for Multiplexers 265(2)
VHDL Modules 267(5)
Four-Bit Full Adder 269(3)
Signals and Constants 272(1)
Arrays 273(3)
VHDL Operators 276(1)
Packages and Libraries 277(2)
IEEE Standard Logic 279(3)
Compilation and Simulation of VHDL Code 282(8)
Problems 283(7)
Latches and Flip-Flops 290(29)
Objectives 290(1)
Study Guide 291(4)
Introduction 295(1)
Set-Reset Latch 296(4)
Gated D Latch 300(1)
Edge-Triggered D Flip-Flop 301(2)
S-R Flip-Flop 303(2)
J-K Flip-Flop 305(1)
T Flip-Flop 306(1)
Flip-Flops with Additional Inputs 307(2)
Summary 309(10)
Problems 310(6)
Programmed Exercise 316(3)
Registers and Counters 319(36)
Objectives 319(1)
Study Guide 320(5)
Registers and Register Transfers 325(4)
Parallel Adder with Accumulator 327(2)
Shift Registers 329(4)
Design of Binary Counters 333(5)
Counters for Other Sequences 338(4)
Counter Design Using D Flip-Flops 341(1)
Counter Design Using S-R and J-K Flip-Flops 342(3)
Derivation of Flip-Flop Input Equations---Summary 345(10)
Problems 349(6)
Analysis of Clocked Sequential Circuits 355(35)
Objectives 355(1)
Study Guide 356(6)
A Sequential Parity Checker 362(2)
Analysis by Signal Tracing and Timing Charts 364(3)
State Tables and Graphs 367(7)
Construction and Interpretation of Timing Charts 372(2)
General Models for Sequential Circuits 374(16)
Programmed Exercise 378(4)
Problems 382(8)
Derivation of State Graphs and Tables 390(35)
Objectives 390(1)
Study Guide 391(2)
Design of a Sequence Detector 393(5)
More Complex Design Problems 398(4)
Guidelines for Construction of State Graphs 402(5)
Serial Data Code Conversion 407(3)
Alphanumeric State Graph Notation 410(15)
Programmed Exercises 412(7)
Problems 419(6)
Reduction of State Tables State Assignment 425(40)
Objectives 425(1)

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